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SAM7S Series [DATASHEET]
6175M–ATARM–26-Oct-12
Figure 19-4. Code Read Optimization in Thumb Mode for FWS = 3
Note:
When FWS is equal to 2 or 3, in case of sequential reads, the first access takes FWS cycles, the second access one cycle, the
third access FWS cycles, the fourth access one cycle, etc.
Flash Access
Master Clock
Data To ARM
0-1
@Byte 0
@2
Bytes 0-3
Bytes 4-7
Bytes 8-11
Bytes 12-15
Bytes 0-3
2-3
6-7
@4
8-9 10-11
4-5
@8
@12
Bytes 4-7
3 Wait State Cycles
Buffer (32 bits)
ARM Request (16-bit)
Code Fetch
Bytes 8-11
3 Wait State Cycles
@6
@10
12-13
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